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S29NS128J0LBFW003 Datasheet(PDF) 8 Page - SPANSION |
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8 / 73 page 8 S29NS-J S29NS-J_00_A11 February 7, 2007 Da ta Sh e e t Figures Figure 3.1 S29NS128J—48-Ball Very Thin FBGA (VDC048) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12 Figure 3.2 S29NS064J—44-Ball Very Thin FBGA (VDD044) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13 Figure 3.3 S29NS032J—44-Ball Very Thin FBGA (VDE044) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14 Figure 3.4 S29NS016J—44-Ball Very Thin FBGA (VDE044) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15 Figure 8.1 Program Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40 Figure 8.2 Erase Operation. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43 Figure 9.1 Data# Polling Algorithm . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46 Figure 9.2 Toggle Bit Algorithm. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48 Figure 10.1 Maximum Negative Overshoot Waveform . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 50 Figure 10.2 Maximum Positive Overshoot Waveform . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 51 Figure 12.1 Test Setup . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 52 Figure 13.1 Input Waveforms and Measurement Levels . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 52 Figure 14.1 VCC Power-up Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 53 Figure 14.2 CLK Characterization. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 53 Figure 14.3 Burst Mode Read (54 MHz) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 54 Figure 14.4 Burst Mode Read (40 MHz) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 55 Figure 14.5 Asynchronous Mode Read. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 56 Figure 14.6 Reset Timings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 57 Figure 14.7 Program Operation Timings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 58 Figure 14.8 Chip/Sector Erase Operations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 58 Figure 14.9 Accelerated Unlock Bypass Programming Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 59 Figure 14.10 Data# Polling Timings (During Embedded Algorithm) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 59 Figure 14.11 Toggle Bit Timings (During Embedded Algorithm). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 59 Figure 14.12 8-, 16-, and 32-Word Linear Burst Address Wrap Around . . . . . . . . . . . . . . . . . . . . . . . . . . . 60 Figure 14.13 Latency with Boundary Crossing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 60 Figure 14.14 Initial Access at 3Eh with Address Boundary Latency . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61 Figure 14.15 Example of Extended Valid Address Reducing Wait State Usage . . . . . . . . . . . . . . . . . . . . 61 Figure 14.16 Back-to-Back Read/Write Cycle Timings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62 Figure 18.1 VDC048 Daisy Chain Layout (Top View, Balls Facing Down) . . . . . . . . . . . . . . . . . . . . . . . . 67 Figure 19.1 VDD044 Daisy Chain Layout (Top View, Balls Facing Down) . . . . . . . . . . . . . . . . . . . . . . . . 68 Figure 20.1 VDE044 Daisy Chain Layout(Top View, Balls Facing Down) . . . . . . . . . . . . . . . . . . . . . . . . 69 |
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