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XA-C3 Datasheet(PDF) 4 Page - NXP Semiconductors

Part No. XA-C3
Description  XA 16-bit microcontroller family 32K/1024 OTP CAN transport layer controller 1 UART, 1 SPI Port, CAN 2.0B, 32 CAN ID Filters, transport layer co-proce
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XA-C3 Datasheet(HTML) 4 Page - NXP Semiconductors

 
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background image
Philips Semiconductors
Preliminary specification
XA-C3
XA 16-bit microcontroller family
32K/1024 OTP CAN transport layer controller
1 UART, 1 SPI Port, CAN 2.0B, 32 CAN ID filters, transport layer co-processor
2000 Jan 25
iii
Pre–Arbitration Based on Object Number
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Message Retrieval
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Transmission of Fragmented Messages
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RTR Handling
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Receiving an RTR Frame
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Transmitting an RTR Frame
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Data integrity issues
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Using the Semaphore Bits, SEM1 and SEM0
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Avoiding Data Corruption for Transmit Message Objects
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OSEK, DEVICENET, AND CANOPEN FRAMES OF INTEREST
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OSEK ConsecutiveFrame
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DeviceNet I/O Message
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CANopen Download Domain Segment Request
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CANopen Auto–Acknowledge Tx Response to Download Domain Segment
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CAN/CTL RELATED INTERRUPTS
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Rx and Tx Message Complete Interrupts
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Rx Buffer Full Interrupt
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Message Error Interrupt
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Tx Buffer Underflow
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Fragmentation Error
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Frame Error Interrupt
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Bus Error
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Pre–Buffer Overflow
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Arbitration Lost
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Error Warning
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Error Passive
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Bus Off
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CAN Interrupt Registers
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CANINTFLG (CAN Interrupt Flag Register)
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FESTR (Frame Error Status Register)
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FEENR (Frame Error Enable Register)
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MCIR (Message Complete Info Register)
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MEIR (Message Error Info Register)
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MCPLH (Message Complete Status Flags High)
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MCPLL (Message Complete Status Flags Low)
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TxERC (Tx Error Counter)
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RxERC (Rx Error Counter)
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EWLR (Error Warning Limit Register)
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ECCR (Error Code Capture Register)
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ALCR (Arbitration Lost Capture Register)
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CAN Interrupt SFRs
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POWER–DOWN AND IDLE MODE
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Background: XA Power–Down and Idle modes
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XA-C3 Idle Mode
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XA-C3 Power–Down Mode
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CAN Sleep Enable
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MEMORY INTERFACE UNIT
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General Description
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Summary of features
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Memory Mapped Registers (MMRs)
54
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Special Function Register MRBH
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Special Function Register MRBL
55
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On–Chip Message Buffer RAM (XRAM)
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MBXSR (Message Buffer and XRAM Segment Register)
56
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