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XIO2200AGGW Datasheet(PDF) 6 Page - Texas Instruments |
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XIO2200AGGW Datasheet(HTML) 6 Page - Texas Instruments |
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6 / 197 page  Tables iv January 12 2006 SCPS154 Table Page 6−4 Upstream Isochronous Window 0 Control Register Description 99 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6−5 Upstream Isochronous Window 1 Control Register Description 100 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6−6 Upstream Isochronous Window 2 Control Register Description 101 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6−7 Upstream Isochronous Window 3 Control Register Description 102 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6−8 GPIO Control Register Description 103 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6−9 GPIO Data Register Description 104 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6−10 Serial-Bus Slave Address Register Description 105 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6−11 Serial-Bus Control and Status Register Description 106 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−1 1394 OHCI Configuration Register Map 108 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−2 Command Register Description 109 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−3 Status Register Description 110 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−4 Class Code and Revision ID Register Description 111 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−5 Latency Timer and Class Cache Line Size Register Description 111 . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−6 Header Type and BIST Register Description 112 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−7 OHCI Base Address Register Description 112 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−8 TI Base Address Register Description 113 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−9 Subsystem Identification Register Description 114 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−10 Interrupt Line and Pin Registers Description 114 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−11 MIN_GNT and MAX_LAT Register Description 115 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−12 OHCI Control Register Description 115 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−13 Capability ID and Next Item Pointer Registers Description 116 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−14 Power Management Capabilities Register Description 116 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−15 Power Management Control and Status Register Description 117 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−16 Power Management Extension Registers Description 117 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−17 PCI PHY Control Register 118 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−18 Miscellaneous Configuration Register 119 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−19 Link Enhancement Control Register Description 120 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7−20 Subsystem Access Register Description 121 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−1 OHCI Register Map 122 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−2 OHCI Version Register Description 124 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−3 GUID ROM Register Description 125 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−4 Asynchronous Transmit Retries Register Description 126 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−5 CSR Control Register Description 127 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−6 Configuration ROM Header Register Description 128 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−7 Bus Options Register Description 129 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−8 Configuration ROM Mapping Register Description 130 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−9 Posted Write Address Low Register Description 131 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−10 Posted Write Address High Register Description 131 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−11 Host Controller Control Register Description 132 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−12 Self-ID Count Register Description 134 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−13 Isochronous Receive Channel Mask High Register Description 135 . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−14 Isochronous Receive Channel Mask Low Register Description 136 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−15 Interrupt Event Register Description 137 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−16 Interrupt Mask Register Description 139 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−17 Isochronous Transmit Interrupt Event Register Description 141 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−18 Isochronous Receive Interrupt Event Register Description 142 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−19 Initial Bandwidth Available Register Description 143 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8−20 Initial Channels Available High Register Description 143 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . |
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