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PXF4336V11 Datasheet(PDF) 10 Page - Infineon Technologies AG |
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PXF4336V11 Datasheet(HTML) 10 Page - Infineon Technologies AG |
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10 / 425 page  ABM-P PXF 4336 V1.1 Table of Contents Page Data Sheet 10 2001-12-17 7.2.25 PLL Control Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 341 7.2.26 ERC Register Access Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 346 7.2.27 External RAM Test Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 349 7.2.28 ABM-P Version Code Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 354 7.2.29 Interrupt Status/Mask Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 356 7.2.30 RAM Select Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 368 7.2.31 Global ABM-P Status and Mode Registers . . . . . . . . . . . . . . . . . . . . . 372 7.2.32 UTOPIA Configuration Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 379 7.2.33 Test Registers/Special Mode Registers . . . . . . . . . . . . . . . . . . . . . . . . 397 8 Electrical Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 398 8.1 Absolute Maximum Ratings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 398 8.2 Operating Range . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 398 8.3 DC Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 399 8.4 AC Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 401 8.4.1 Microprocessor Interface Timing Intel Mode . . . . . . . . . . . . . . . . . . . . 403 8.4.1.1 Microprocessor Write Cycle Timing (Intel) . . . . . . . . . . . . . . . . . . . . 403 8.4.1.2 Microprocessor Read Cycle Timing (Intel) . . . . . . . . . . . . . . . . . . . . 404 8.4.2 Microprocessor Interface Timing Motorola Mode . . . . . . . . . . . . . . . . 405 8.4.2.1 Microprocessor Write Cycle Timing (Motorola) . . . . . . . . . . . . . . . . 405 8.4.2.2 Microprocessor Read Cycle Timing (Motorola) . . . . . . . . . . . . . . . . 406 8.4.3 UTOPIA Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 408 8.4.4 CPR SSRAM Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 413 8.4.5 CSR SDRAM Interface(s) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 414 8.4.6 Reset Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 415 8.4.7 Boundary-Scan Test Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 416 8.4.8 SPI Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 417 8.4.9 Queue Congestion Interface (QCI) . . . . . . . . . . . . . . . . . . . . . . . . . . . 418 8.5 Capacitances . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 419 8.6 Package Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 419 9Test Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 420 10 Package Outlines . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 422 11 Glossary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 423 |
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