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PXB4219E Datasheet(PDF) 9 Page - Infineon Technologies AG

Part # PXB4219E
Description  Interworking Element for 8 E1/T1 Lines
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Manufacturer  INFINEON [Infineon Technologies AG]
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PXB4219E Datasheet(HTML) 9 Page - Infineon Technologies AG

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IWE8, V3.4
PXB 4219E, PXB 4220E, PXB 4221E
Table of Contents
Page
Data Sheet
9
2003-01-20
9.6.2
Framer Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 248
9.6.2.1
Framer Interface in FAM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 248
9.6.2.2
Framer Interface in GIM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 251
9.6.2.3
Framer Interface in SYM Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . 254
9.6.2.4
Framer Interface in EC Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 256
9.6.3
UTOPIA Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 256
9.6.4
IMA Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 260
9.6.5
Clock Recovery Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 261
9.6.6
Microprocessor Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 262
9.6.6.1
Intel Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 262
9.6.6.2
Motorola Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 264
9.6.7
RAM Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 265
9.6.8
Boundary-Scan Test Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 267
10
Testmode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 268
10.1
Device Identification Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 268
10.2
Instruction Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 268
10.3
Boundary-Scan Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 268
11
Package Outlines . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 273
12
Appendix . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 274
12.1
ATM Adaptation Layer 1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 274
12.2
Synchronous Residual Time Stamp SRTS . . . . . . . . . . . . . . . . . . . . . . . 278
12.3
Adaptive Clock Method ACM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 280
12.4
Channel Associated Signalling . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 281
12.4.1
E1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 281
12.4.2
DS1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 282
13
Contacts for SRTS Patent Fee . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 284
14
Glossary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 285
15
Bibliography . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 288


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