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PEB20560V21 Datasheet(PDF) 7 Page - Infineon Technologies AG |
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7 / 433 page  Semiconductor Group I-5 2003-08 PEB 20560 Table of Contents Page 3.1.6.1 Hardware Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-17 3.1.6.2 EPIC ®-1 Initialization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-17 3.1.6.2.1 EPIC ® Registers Initialization . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-17 3.1.6.2.2 Control Memory Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-17 3.1.6.2.3 Initialization of Pre-processed Channels . . . . . . . . . . . . . . . . . . . 3-18 3.1.6.2.4 Initialization of the Upstream Data Memory (DM) Tri-State Field . 3-19 3.1.6.3 SACCO-Initialization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-20 3.1.6.4 Initialization of D-Channel Arbiter . . . . . . . . . . . . . . . . . . . . . . . . . . 3-21 3.1.6.5 Activation of the PCM- and CFI-Interfaces . . . . . . . . . . . . . . . . . . . 3-22 3.1.6.6 Initialization Example . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-23 3.1.6.6.1 EPIC ®-1 Initialization Example . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-24 3.1.6.6.2 SACCO-A Initialization Example . . . . . . . . . . . . . . . . . . . . . . . . . 3-26 3.1.6.6.3 D-Channel Arbiter Initialization Example . . . . . . . . . . . . . . . . . . . 3-26 3.1.6.6.4 PCM- and CFI-Interface Activation Example . . . . . . . . . . . . . . . . 3-27 3.1.6.6.5 SACCO-B Initialization Example . . . . . . . . . . . . . . . . . . . . . . . . . 3-27 3.2 SIDEC . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-28 4 DSP Core OAK . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-1 4.1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-1 4.1.1 General Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-1 4.1.2 Architecture Highlights . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-1 4.2 Architecture Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-3 4.2.1 Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-3 4.2.2 Buses . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-4 4.2.2.1 Data Buses . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-4 4.2.2.2 Program Buses . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-4 4.2.3 Memory Spaces and Organization . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-5 4.2.3.1 Program Memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-5 4.2.3.2 Data Memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-6 4.3 Development Tools . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-7 4.3.1 COFF Macro Assembler . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-7 4.3.2 Linker/Locator . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-7 4.3.3 Object Format Convertor . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-7 4.3.4 ANSI C-Compiler . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-7 4.3.5 Simulator . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-8 4.3.6 Debugger . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-8 5 Description of Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5-1 5.1 µP Address Space Register Overview . . . . . . . . . . . . . . . . . . . . . . . . . 5-1 5.1.1 ELIC0 and ELIC1 Registers Description . . . . . . . . . . . . . . . . . . . . . . 5-22 5.1.1.1 Interrupt Top Level . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5-22 5.1.1.1.1 Interrupt Status Register (ISTA) . . . . . . . . . . . . . . . . . . . . . . . . . . 5-22 |
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