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AK8142 Datasheet(PDF) 9 Page - Asahi Kasei Microsystems |
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AK8142 Datasheet(HTML) 9 Page - Asahi Kasei Microsystems |
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9 / 19 page  [AK8142] MS0932-J-01 2009/1 - 9 - 3－2）レジスタマップ FA～FFは２面構成で、F7レジスタのBANK,BANKWR,CTLFSELで制御されます。“－”は、０が読み出されます。 下段：リセット値 注意： SFTRST ビットはパワーオンリセットでリセットされません。 ｱﾄﾞ ﾚｽ D7 D6 D5 D4 D3 D2 D1 D0 備考 － － － － － － FRAC[17] FRAC[16] FF 0 0 FRAC[15] FRAC[14] FRAC[13] FRAC[12] FRAC[11] FRAC[10] FRAC[9] FRAC[8] FE 0 0 0 0 0 0 0 0 FRAC[7] FRAC[6] FRAC[5] FRAC[4] FRAC[3] FRAC[2] FRAC[1] FRAC[0] FD 0 0 0 0 0 0 0 0 ⊿Σ小数部 － INT[6] INT[5] INT[4] INT[3] INT[2] INT[1] INT[0] FC 0 １ 0 0 0 0 0 ⊿Σ整数部 － OUTC[2] OUTC[1] OUTC[0] ODIVPG[3] ODIVPG[2] ODIVPG[1] ODIVPG[0] FB １ １ １ 0 １ １ １ OUTDIV制御 MDIVC[3] MDIVC[2] MDIVC[1] MDIVC[0] MDIVP[3] MDIVP[2] MDIVP[1] MDIVP[0] FA 0 １ １ 0 0 0 0 １ MDIV制御 － － － － ｒｅｓｅｒｖｅｄ ｒｅｓｅｒｖｅｄ ｒｅｓｅｒｖｅｄ ｒｅｓｅｒｖｅｄ F9 0 １ 0 １ 予約 － － － － ｒｅｓｅｒｖｅｄ ｒｅｓｅｒｖｅｄ ｒｅｓｅｒｖｅｄ ｒｅｓｅｒｖｅｄ F8 0 0 0 0 予約 BANK BANKWR CTLFSEL CKOFF[1] CKOFF[0] ｒｅｓｅｒｖｅｄ PD SFTRST* F7 0 0 0 1 0 0 0 0 ﾘｾｯﾄ制御 BANK制御 － － － － CKOUTEN [1] REFOTEN [0] REFOTEN [1] REFOTEN [0] F6 0 0 0 0 OUTBUF制御 － － － － － － DUMON DITHER F5 0 1 ⊿Σ制御 F4 － － － － － － － － テスト ～ － － － － － － － － テスト F1 － － － － － － － － テスト F1～F4はテスト用レジスタがありますのでライトアクセスしないでください。 |
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