HYMD264G726D8M-K datasheet(7/30 Pages) HYNIX

Part #	HYMD264G726D8M-K

Description	184pin Registered DDR SDRAM DIMMs

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Manufacturer	HYNIX [Hynix Semiconductor]

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Rev. 1.1 /May. 2005

7

184pin Registered DDR SDRAM DIMMs

1GB, 128Mb x 72 ECC Registered DIMM : HYM212G726DS[P]4[M]

FUNCTIONAL BLOCK DIAGRAM

Note :

1. DQ-to-I/O wiring may be changed within a byte.

2. DQ/DQS/DM/CKE/S relationships must be maintained as shown.

3. DQ/DQS resistors should be 22 Ohms.

4. VDDID strap connections (for memory device VDD,VDDQ) :

STRAP OUT (OPEN) : VDD = VDDQ

STRAP IN (VSS) : VDD ≠ VDDQ

5. Address and control resistors should be 22 Ohms.

6. Each Chip Select and CKE pair alternate between decks for thermal

enhancement.

DQ00

DQ01

DQ02

DQ03

DQS /CS

DM

D0

DQS0

/RS0

DM0/DQS9

VSS

I/O0

I/O1

I/O2

I/O3

DQ04

DQ05

DQ06

DQ07

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D9

I/O0

I/O1

I/O2

I/O3

DQ08

DQ09

DQ10

DQ11

DQS /CS

DM

D1

DQS1

DM1/DQS10

I/O0

I/O1

I/O2

I/O3

DQ12

DQ13

DQ14

DQ15

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D10

I/O0

I/O1

I/O2

I/O3

DQ16

DQ17

DQ18

DQ19

DQS /CS

DM

D2

DQS2

DM2/DQS11

I/O0

I/O1

I/O2

I/O3

DQ20

DQ21

DQ22

DQ23

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D11

I/O0

I/O1

I/O2

I/O3

DQ24

DQ25

DQ26

DQ27

DQS /CS

DM

D3

DQS3

DM3/DQS12

I/O0

I/O1

I/O2

I/O3

DQ28

DQ29

DQ30

DQ31

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D12

I/O0

I/O1

I/O2

I/O3

DQ32

DQ33

DQ34

DQ35

DQS /CS

DM

D4

DQS4

DM4/DQS13

I/O0

I/O1

I/O2

I/O3

DQ36

DQ37

DQ38

DQ39

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D13

I/O0

I/O1

I/O2

I/O3

DQ40

DQ41

DQ42

DQ43

DQS /CS

DM

D5

DQS5

DM5/DQS14

I/O0

I/O1

I/O2

I/O3

DQ44

DQ45

DQ46

DQ47

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D14

I/O0

I/O1

I/O2

I/O3

DQ48

DQ49

DQ50

DQ51

DQS /CS

DM

D6

DQS6

DM6/DQS15

I/O0

I/O1

I/O2

I/O3

DQ52

DQ53

DQ54

DQ55

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D15

I/O0

I/O1

I/O2

I/O3

DQ56

DQ57

DQ58

DQ59

DQS /CS

DM

D7

DQS7

DM7/DQS16

I/O0

I/O1

I/O2

I/O3

DQ60

DQ61

DQ62

DQ63

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D16

I/O0

I/O1

I/O2

I/O3

CB0

CB1

CB2

CB3

DQS /CS

DM

D8

DQS8

DM8/DQS17

I/O0

I/O1

I/O2

I/O3

CB4

CB5

CB6

CB7

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D17

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D18

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D19

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D20

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D21

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D22

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D23

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D24

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D25

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D26

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D27

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D28

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D29

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D30

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D31

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D32

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D33

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D34

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D0

I/O0

I/O1

I/O2

I/O3

DQS /CS

DM

D35

I/O0

I/O1

I/O2

I/O3

/RS1

VDDSPD

VDD

VREF

VSS

Serial PD

DO-D35

Strap:see Note 4

VDDQ

VDDID

DO-D35

WP

A0 A1 A2

SDA

SA0 SA1SA2

Serial PD

SCL

CKO, /CKO------PLL*

* Wire per Clock Loading Table/Wiring Diagram

A0-A12

/RAS

/CAS

CKE0

/WE

RA0-RA12-> : A0->A12 : SDRAMs D0-D35

/RRAS->/RAS : SDRAMs D0-D35

/RCAS->/CAS : SDRAMs D0-D35

RCKE0->CKE : SDRAMs D0-D17

/RWE->WE : SDRAMs D0-D35

/S1

BA0-BA1

/RS1->/CS : SDRAMs D18-D35

RBA0-RBA1-> : BA0->BA1 : SDRAMs D0-D35

R

E

G

I

S

T

E

R

/RESET

/PCK

PCK

CKE1

RCKE1->CKE : SDRAMs D18-D35

/S0

/RS0->/CS : SDRAMs D0-D17

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